图1 74LSl61的逻辑电路图和引脚图 (1)异步清零功能 当CR=0时,不管其他输人真个状态如何(包括时钟信号CP),4个触发器的输出全为零。 (2)同步并行预置数功能 在CR=1的条件下,当LD=0且有时钟脉冲CP的上升沿作用时,D3,D2,D1,D0输入真个数据将分别被Q3~Q0所接收。由于置数操纵必须有CP脉冲上升沿相配合,故称为同步置数。 (3)保持功能 在CR=LD=1的条件下,当T=P=0时,不管有无CP脉冲作用,计数器都将保持原有状态不变(停止计数) 。 (4)同步二进制计数功能 当CR=LD=P=T=1时,74LS161处于计数状态,电路从0000状态开始,连续输入16个计数脉冲后,电路 将从1111状态返回到0000状态,状态表见表2。 (5)进位输出C 当计数控制端T=1,且触发器全为1时,进位输出为1,否则为零。 表1 74LS161的功能表
表2
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