内部方框图：
【代换】【ADE7758的】【内容导航】 第1页：第2页：引脚功能 ⑴ APCF：有功功率校正频率逻辑输出引脚。 该引脚的输出主要用于校准和操作的目的。满刻度输出频率可以写入APCFNUM 和APEFDEN 寄存器中。 ⑵ DGND：ADE7758数字电路部分参考地端，例如乘法器、滤波器、数－频转换器的地端。 由于ADE7758 中的回路电流很小，可以直接跟整个系统的模拟地端（AGND）相连，但是DOUT端的大总线电容产生的数字噪声电流可能会影响其性能。 ⑶ DVDD：数字电源。该引脚为ADE7758 数字部分提供电压源。 电压维持在5V±5%。该引脚可用一个10μF 的电容和一个100nF 的瓷片电容并联后进行去耦合。 ⑷ AVDD：模拟电源端。该引脚为ADE7758模拟部分提供电压源。电压维持在5V±5%。 该引脚应该采用正确的去耦方法，尽量减小电源波动和噪声。该引脚用一个10μF 的电容和一个100nF 的瓷片电容并联后，再连接到AGAND 引脚来去耦合。 ⑸"⑽ IAP，IAN；IBP，IBN；ICP，ICN：电流通道模拟输入。 这些输入是全差动电压输入，最大的差动输入信号为±0.5V，±0.25V，±0.125V。根据内部放大器的增益选择，来设定输入电压的最大值，增益选择放大器的增益由PGA 寄存器来设定。所有的输入引脚均能承受±6V 的过电压而不会造成永久损坏，并具有静电释放保护电路。 （11） AGND：模拟电路部分的参考地端。 该引脚为内部的ADCS、温度敏感元件、参考电压端等部分的参考地端。该引脚应该连接到系统的标准模拟地或者干扰最小的接地参考点。干扰最小的接地参考点应该跟所有的模拟线路相连。为了减小ADE7758 的地端噪声，模拟地端应该和数字地端只用一个点来连接。也可以把整个器件都安放在模拟接地面上。 （12） REFIN/OUT：该引脚是片上基准电压。 片上基准电压标称值为2.5V±8% 。外部参考端也可以与该脚相连。无论是否连接外部参考电压端，该引脚都应该用一个1μF 的瓷片电容跟AGND 端连接以去偶合。 （13）"（16） VN，VCP，CBP，VAP：电压通道的模拟输入。 这些输入是单端电压输入，最大信号电压为±0.5V，（相对于VN 端）。可以通过内部寄存器PGA选择输入信号的最大值为±0.5V，±0.25V 或者±0.125V。所有的输入引脚均能承受±6V 的过电压而不会造成永久损坏，并具有静电释放保护电路。 （17） VARCF：复功率校准频率逻辑输出。 通过设置WAVMODE 寄存器的VACF 位来选择输出复功率或者视在功率。该输出常用于电能表的校准。满刻度输出可以通过写入VARCFNUM 和VARCFDEN 寄存器的数值来调节。 （18） IRQ：中断请求输出。低电平有效的开漏极逻辑输出端。 可屏蔽的中断包括：有功能量寄存器和视在功率寄存器半满和波形采样速率达到26kSPS。 （19） CLKIN：数字信号处理ADCS 的主时钟。最高为15MHz。 可以用一个外部时钟信号来提供时钟输入，也可以在CLKIN 和 CLKOUT 端并联一个AT 晶体来提供时钟信号。应该根据晶体的参数确定所需要的负载电容值，接一个几十PF 的瓷片电容到振荡门电。 （20） CLKOUT：当外部时钟提供或者连接一个晶体时，该引脚能驱动一个CMOS 负载。 （21） CS：片选信号，低电平有效。这时ADE7758 与数据总线接通。 （22） DIN：串行接口的数据输入端。在串行口的时钟信号SCLK 的下降沿输入数据。 （23） SCLK：串行时钟信号输入端。 所有串行数据被该信号同步。该引脚具有施密特触发输入，以适应速度较慢的边沿变化时间。 （24） DOUT：串行口的数据输出端。 在SCLK 信号的上升沿数据从该引脚传输出去。在没有数据的时候该引脚为高阻抗状态。上一页1【内容导航】 第1页：第2页：引脚功能
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